I ricercatori della UC San Diego segnano un passo importante nell’elettronica di potenza con un nuovo convertitore DC-DC ibrido a risonatore piezoelettrico capace di raggiungere una efficienza di picco del 96,2% nella conversione da 48 a 4,8 volt. Il risultato, pubblicato su Nature Communications, introduce una topologia denominata Always-Multi-Path Embedded Flying Capacitor Piezoelectric Resonator-based DC-DC converter, progettata per superare i limiti storici dei convertitori piezoelettrici tradizionali in termini di corrente e perdite di carica. Il nuovo schema modifica il rapporto di conversione ottimale del risonatore da 2:1 a 3:1, ottenendo un rapporto netto di 9:1 e una corrente di uscita quadruplicata, caratteristica chiave per le future architetture di alimentazione dei data center a 48 volt destinati a intelligenza artificiale, cloud computing e Internet of Things.
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La topologia AMP-EFC elimina i limiti dei convertitori piezoelettrici tradizionali
Il cuore dell’innovazione è la topologia Always-Multi-Path Embedded Flying Capacitor, abbreviata in AMP-EFC, che affronta il problema più critico dei convertitori piezoelettrici: la perdita di efficienza quando il rapporto di conversione supera 2:1. Nei design tradizionali, l’aumento della fase di circolazione riduce il fattore di utilizzazione della carica e limita la corrente massima gestibile dal risonatore. Il nuovo approccio integra condensatori volanti embedded che introducono un nodo DC intermedio e cambiano dinamicamente la sequenza di commutazione senza interrompere il trasferimento di energia. Questo consente di mantenere il coefficiente di utilizzo della carica K pari a 1 nel rapporto ottimale 3:1, riducendo la corrente di risonanza e abbassando le perdite meccaniche nel materiale piezoelettrico. Il risultato è una topologia più efficiente, più scalabile e molto più adatta ai carichi moderni ad alta densità.
Il funzionamento always-multi-path quadruplica la corrente di uscita
Un secondo elemento decisivo è la rete switched-capacitor sul lato di uscita, che implementa il funzionamento always-multi-path. Due condensatori aggiuntivi alternano configurazioni serie-parallelo durante le fasi di potenza, garantendo un flusso di corrente più continuo e riducendo drasticamente il ripple in uscita. Secondo i dati sperimentali, l’ampiezza della corrente del risonatore si riduce di oltre l’81% rispetto al baseline, mentre la corrente di uscita può arrivare fino a quattro volte superiore rispetto alle architetture piezoelettriche convenzionali. Questo aspetto è cruciale perché uno dei limiti storici dei risonatori piezoelettrici è sempre stato la bassa densità di corrente. Posizionando il risonatore sul lato ad alta tensione e bassa corrente, il design sfrutta al massimo le proprietà fisiche del componente, trasformando un punto debole in un vantaggio competitivo.
Il chip in CMOS 180 nm dimostra efficienza record e formato compatto
La realizzazione pratica del convertitore rafforza ulteriormente il valore del progetto. Il chip è stato prodotto in processo CMOS high-voltage a 180 nm e occupa un’area di appena 3,2 x 2,0 mm, includendo 13 interruttori di potenza, driver, bootstrap e blocchi digitali di bias. Il risonatore piezoelettrico in PZT, con diametro 20 mm e spessore 0,25 mm, opera tra 115 e 129 kHz nella regione induttiva. Le misure di laboratorio confermano un comportamento coerente con la teoria: la tensione ai terminali del risonatore non collassa a zero, le fasi di circolazione restano brevi vicino al rapporto ottimale di 9:1 e l’ondulazione di corrente resta bilanciata. A 48 volt di ingresso, il convertitore raggiunge 96,2% di efficienza con 150 mA, mentre a 24 e 36 volt resta sopra il 94%, risultati superiori a molte soluzioni magnetiche equivalenti.
I data center a 48 V per AI e cloud sono il vero obiettivo della tecnologia
La spinta verso bus a 48 volt nei data center nasce dall’esigenza di ridurre le perdite di conduzione, che possono diminuire fino a 16 volte rispetto alle architetture a 12 V. Tuttavia, questa evoluzione richiede convertitori capaci di gestire elevati rapporti di conversione senza ricorrere a cascata di stadi, soluzione inefficiente sia sul piano energetico sia volumetrico. I convertitori magnetici tradizionali restano dominanti, ma soffrono di limiti di scalabilità volume-frequenza e di problematiche elettromagnetiche. Il nuovo convertitore piezoelettrico proposto da UC San Diego si inserisce perfettamente in questo scenario, offrendo forma piana, spessore ridotto, produzione batch e futura integrazione su silicio, caratteristiche ideali per rack AI, acceleratori e sistemi edge ad alta densità.
Il confronto con i convertitori magnetici cambia l’elettronica di potenza
Il valore strategico della ricerca emerge nel confronto diretto con le tecnologie esistenti. I risonatori piezoelettrici offrono una scalabilità volume-frequenza superiore ai magnetici, consentendo design più sottili e adatti all’integrazione chip-level. La topologia proposta elimina inoltre le perdite tipiche delle architetture a più stadi e mantiene soft switching sugli interruttori critici, riducendo dissipazione e stress elettrico. Rispetto alle precedenti topologie front-side, back-side o dual-side switched capacitor, l’approccio embedded flying capacitor modifica direttamente il rapporto di conversione ottimale del risonatore, preservando i benefici della commutazione morbida anche in scenari ad alta tensione. Questo consente di ottenere una densità di corrente volumetrica oltre dieci volte superiore rispetto a implementazioni discrete, spostando i convertitori piezoelettrici da tecnologia sperimentale a candidata reale per applicazioni industriali.
La nuova architettura apre la strada ai futuri power delivery per AI
Le implicazioni future vanno oltre il singolo chip. Il lavoro dimostra che i convertitori piezoelettrici integrati possono competere direttamente con le migliori soluzioni magnetiche in applicazioni ad alto rapporto di conversione e alta densità di corrente. Con l’evoluzione dei materiali, dal PZT al niobato di litio, e con la possibilità di fabbricare risonatori direttamente su silicio, la densità di potenza potrà crescere ulteriormente. L’eliminazione di driver isolati e componenti passivi esterni riduce complessità PCB, costi e volume, elementi essenziali nei sistemi AI hyperscale. La combinazione di 96,2% di efficienza, rapporto 9:1, corrente quadruplicata e piena compatibilità con i data center a 48 volt rende questa architettura una delle proposte più promettenti per la prossima generazione di alimentazione ad alta efficienza.
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